해피레포트 - [전자전기] 논리회로실험 - decoder encoder with en VHDL을 이용한 실험 결과 보고서

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공학,기술계열 [전자전기] 논리회로실험 - decoder encoder with en VHDL을 이용한 실험 결과 보고서 [전자전기] decoder_encoder_with_en_VHDL을 이용한 실험 결과보고서.hwp 등록인 february 등록/수정일 09.11.04 / 09.12.05 문서분량 4 페이지 다운로드 2 구매평가 판매가격 500원

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3x8 Decoder , 8x3 Encoder 설계 ƒ. 실험내용 1) 3x8 Decoder(data flow modeling) ※진리표 ※회로도 ENX (2)X (1)X (0)D (7)D (6)D (5)D (4)D (3)D (2)D (1)D (0)0---00000000100000000001100100000010101000000100101100001000110000010000110100100000111001000000111110000000 입력 -- X in std_logic_vector(2 downto 0) EN in std_logic ☞ Enable 출력 -- D out std_logic_vector(7 downto 0) „) 3x8 Decoder(Behavioral modeling) - case문 사용 …) 8x3 Encoder(Behavioral modeling) - case문 사용 ※진리표 END (7)D (6)D (5)D (4)D (3)D (2)D (1)D (0)X (2)X (1)X (0)0--------000100000001000100000010001100000100010100001000011100010000100100100000101101000000110110000000111 ※ Source Codeƒ) 3X8 decoder dataflow modeling library ieee; use ieee.std_logic_1164.all; entity decoder_dataflow is port( en in std_logic; x in std_logic_vector(2 downto 0); d out std_logic_ve...

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