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  • [A+ 4.5 예비레포트] 기초전자공학실험 - JFET 특성, JFET 바이어스 회로(PSpice 포함)

  • A+ 45 예비레포트 기초전자공학실험.hwp
  • 등록인 tjr6155
  • 등록/수정일 21.04.21 / 21.04.21
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[A+ 4.5 예비레포트] 기초전자공학실험 - JFET 특성, JFET 바이어스 회로(PSpice 포함)
[A+ 4.5 예비레포트] 기초전자공학실험 - JFET 특성, JFET 바이어스 회로(PSpice 포함)
본문일부/목차
전압분배기 바이어스 회로 해석
이므로 이다. 입력 측에서 KVL을 적용하면


부하선의 방정식으로 직선을 그려 동작점을 결정할 수 있다.




PSpice 모의실험 12-1

< PSpice 모의실험 12-1 >


1. 드레인-소스 전압
답 : 2.235V

2. 게이트-소스 전압
답 : 891.1mV

3. 드레인 전류
답 : 2.577mA
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