해피레포트 - [디지털 회로설계] Moore , Mealy Type Finite State Machine

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공학,기술계열 [디지털 회로설계] Moore , Mealy Type Finite State Machine [디지털 회로설계] Moore ,.hwp 등록인 leewk2547 등록/수정일 13.07.30 / 13.07.30 문서분량 9 페이지 다운로드 0 구매평가 판매가격 2,000원

보고서설명
개요 : Moore Type과 Mealy type의 state diagram을 보고 각각의 state table과 D F/F을 이용한 회로도를 작성한 후 두 가지 모두에 대하여 각각 VHDL code를 작성하여 시뮬레이션을 수행하여 미리 예상한 결과와 비교하여 본다. 이를 통해 Moore type과 meanly type의 이해도를 높이고 그 동작을 비교하여 파악한다. D F/F의 응용회로 설계 능력을 키운다.

본문일부/목차
(1) sequential circuit 입력이 시간적으로 차례차례 가해질 경우, 어떤 정해진 입력계열에 대해 특정한 응답을 하는 전기회로를 가리킨다. 회로의 내부에 미리 와 있던 논리신호계열에 따른 기억상태가 있는데, 미리 정해진 순서로 도달했을 때에 처음으로 출력이 나타나도록 구성한다. 전화교환이나 텔렉스 등 오차를 적게 해야 하는 부호회로에 널리 사용된다 (2) Moore type 출력결과가 현재의 상태에만 영향을 받는 회로를 말한다. Moore type으로 simulation을 하여 위와 같은 waveform이 출력되었다. state diagram과 state table의 결과와 비교해 보면 결과 값이 정확히 출력된 것을 확인할 수 있다. state diagram을 살펴보자 w값이 0이 지속되면 A와 B를 왕복하며 z값이 0과 1로 변한다. z값이 1인 상태에서 w값이 1로 바뀌면 C 상태로 넘어가 z는 0이 되고 w가 1이 지속되니 계속 C 상태에 머물게 된다. 그 후 w가 0이 되면 D state로 넘어가 z값이 1로 바뀌는 것이다. 이러한 state의 변화가 있었는데 resetn 값을 0을 입력하니 1이던 z값이 0으로 바뀌는 것을 확인하였다.

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